一种MPU与FPGA扩展多串口的实现方法

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专利状态

一种MPU与FPGA扩展多串口的实现方法

有效

专利申请进度

申请

2018-12-06

申请公布

2019-06-07

授权

2021-04-09

预估到期

2038-12-06

专利基础信息

申请号	CN201811485584.0	申请日	2018-12-06
申请公布号	CN109857685A	申请公布日	2019-06-07
授权公布号	CN109857685B	授权公告日	2021-04-09
分类号	G06F13/28;G06F13/42;G06F11/10
分类	计算；推算；计数;
申请人名称	积成电子股份有限公司
申请人地址	山东省济南市科航路1677号

专利法律状态

2021-04-09

授权

状态信息

授权
2019-07-02

实质审查的生效

状态信息

实质审查的生效IPC（主分类）:G06F 13/28
2019-06-07

公布

状态信息

公开

摘要

本发明涉及一种MPU与FPGA扩展多串口的实现方法，在数据传输中使用MPU内部的DMA控制器进行数据的传输与控制；在FPGA侧，当串口检测到开始信号，FPGA通过串口配置模块中的寄存器的参数对接收到的数据进行解帧、存储，当存入一帧字节后，接收FIFO在此帧数据后添加时间戳；发送数据时，相关串口根据其相应的串口配置模块中的寄存器的参数对发送FIFO中的数据进行组帧，然后通过串口发送出去；在MPU侧，控制串口数据的收发，MPU通过FPGA扩展的每路串口定义的相关寄存器地址进行寻址操作，MPU通过中断查询的方式定时地对相关串口进行轮询操作。本发明具有高效精准、复用性强、研制周期短、成本低的优点；同时也降低了产品成本，增强了产品的易维护性。

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